Recuerdo haber aprendido en la escuela que uno puede construir cualquier circuito lógico desde NAND
o solo NOR
puertas.
En primer lugar, me pregunto si así es como se hace realmente: es decir, cuando Intel fabrica una CPU, ¿construyen todos los registros, etc. usando NAND
/ NOR
gates, o tienen alguna otra forma más elegante de hacer las cosas?
En segundo lugar, me pregunto si construir todo de esta manera aumenta el retraso de propagación en comparación con un circuito hecho también con puertas AND
/ OR
/ NOT
.
Sé que cuando uso PMOS
/ NMOS
configuraciones para construir puertas, una AND
o una OR
sale como 2 etapas en lugar de una NAND
o una NOR
que son ambas 1. Como sé que puede hacer una AND
de 2 NAND
sy una OR
cascada de 2 NOR
s, parece que el retraso de propagación no aumentaría mientras los fabricantes usaran NAND
s y NOR
s.
¿Alguien tiene alguna idea de todo esto, especialmente en cuanto a lo que realmente se hace en los CI fabricados?
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NAND
yNOR
puertas, y la menor cantidad posible? ¿Esto casi siempre producirá un mejor diseño (en términos de retraso / recuento de puertas) que si abordara el problema usando un repertorio completo de puertas y luego reemplazaraAND
/OR
/NOT
puertas con susNAND
/NOR
equivalentes?Mi inclinación con CMOS es pensar en un bloque de construcción básico como un inversor precedido por una combinación arbitraria de puertas independientes "y" y "o" sin interconexiones entre ellas; todas las siguientes funciones:
tienen esencialmente el mismo costo en silicio, aunque solo los dos últimos tienen nombres. Intentar componer las dos funciones anteriores usando alguna combinación de compuertas NAND o NOR produciría algo mucho más grande y más lento de lo que sería una realización directa.
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